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Erschienen in:
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2018 | OriginalPaper | Buchkapitel

A Radiation-Immune Low-Jitter High-Frequency PLL for SerDes

verfasst von : Hengzhou Yuan, Jianjun Chen, Bin Liang, Yang Guo

Erschienen in: Computer Engineering and Technology

Verlag: Springer Singapore

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Abstract

A radiation-tolerant phase-locked loop (PLL) is designed in 65 nm CMOS technology. A double feedback loop self-sampling structure is proposed to improve the anti-radiation capability. A High matched current-based charge pump is hardened by using sensitive nodes compression and transformation technology. The simulation results show that the proposed PLL has no significant variations under heavy-ion and it could output good jitter signals with high frequency.

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Literatur
1.
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7.
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8.
Fischette, D., et al.: A 45 nm SOI-CMOS dual-PLL processor clock system for multi-protocol I/O. In: ISSCC Digest of Technical Papers, pp. 246–247, February 2010
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Brownlee, M., et al.: Single-event transient characterization of a radiation-tolerant charge-pump phase-locked loop fabricated in 130 nm PD-SOI technology. IEEE Trans. Nucl. Sci. 63(4), 2402–2408 (2016)CrossRef
Metadaten
Titel
A Radiation-Immune Low-Jitter High-Frequency PLL for SerDes
verfasst von
Hengzhou Yuan
Jianjun Chen
Bin Liang
Yang Guo
Copyright-Jahr
2018
Verlag
Springer Singapore
Buch
Computer Engineering and Technology

Print ISBN: 978-981-10-7843-9

Electronic ISBN: 978-981-10-7844-6

Copyright-Jahr: 2018

DOI
https://doi.org/10.1007/978-981-10-7844-6_5

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