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2017 | OriginalPaper | Buchkapitel

1. Introduction to HDL

verfasst von : Vaibbhav Taraate

Erschienen in: PLD Based Design with VHDL

Verlag: Springer Singapore

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Abstract

This chapter discusses the digital logic design evolution and the basic ASIC design flow. The chapter describes the necessity of ASIC SOC prototype. The comparison of ASIC and FPGA implementation is described in this chapter. The chapter even discusses the need of HDL and VHDL different modeling styles using the small gate count example. This chapter is useful to the HDL beginners to understand about the difference between high-level language and HDL modeling styles.

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Metadaten
Titel
Introduction to HDL
verfasst von
Vaibbhav Taraate
Copyright-Jahr
2017
Verlag
Springer Singapore
DOI
https://doi.org/10.1007/978-981-10-3296-7_1

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