Erschienen in:

2023 | OriginalPaper | Buchkapitel

5. Layoutentwurf in Schritten: Von der Netzliste bis zum Layout-Postprozess

verfasst von : Jens Lienig, Jürgen Scheible

Erschienen in: Grundlagen des Layoutentwurfs elektronischer Schaltungen

Verlag: Springer International Publishing

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Zusammenfassung

Der Beitrag 'Layoutentwurf in Schritten: Von der Netzliste bis zum Layout-Postprozess' behandelt umfassend die verschiedenen Phasen des Layoutentwurfs in der Elektronik. Nach einer Einführung in die Modelle und Stile des heutigen Layoutentwurfs wird die Erstellung von Netzlisten detailliert erläutert, sei es durch Hardware-Beschreibungssprachen im digitalen Design oder durch Schaltplaneingaben im analogen Entwurf. Besondere Aufmerksamkeit wird der Partitionierung, dem Floorplanning, der Platzierung und Verdrahtung gewidmet, wobei die Herausforderungen bei der Verdrahtung von Millionen von Netzen und die Notwendigkeit von Global- und Detailverdrahtung beleuchtet werden. Die Verifikation des Layouts, einschließlich der Timing- und Layoutverifikation, wird ebenfalls gründlich behandelt. Ein weiterer Schwerpunkt liegt auf der symbolischen Kompaktierung und dem Layout-Postprozess, der Techniken zur Auflösungsverbesserung und die Anpassung an verschiedene Technologieknoten umfasst. Der Beitrag hebt sich durch seine detaillierte und praxisnahe Darstellung der komplexen Prozesse im Layoutentwurf hervor, was ihn besonders wertvoll für Experten in der Elektronikindustrie macht.

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Vorheriges Kapitel Layoutentwurf im Überblick: Modelle, Stile, Aufgaben und Abläufe

Nächstes Kapitel Besonderheiten des Layoutentwurfs analoger integrierter Schaltungen

IEEE Standard 91-1984, IEEE Standard Graphic Symbols for Logic Functions, und IEEE Standard 91a-1991, Supplement to IEEE Standard 91-1984.

IEC 60617 Grafische Symbole für Diagramme.

Der sogenannte „Pentium-FDIV-Bug“ ist ein bekanntes Beispiel, bei dem ein gut simulierter Intel-Prozessor bei der Division einer Zahl falsche binäre Gleitkomma-Ergebnisse lieferte, was Intel einen Verlust von 475 Millionen Dollar einbrachte [12].

Es ist wichtig zu wissen, warum wir keine anderen Layout-Informationen, wie z. B. Bibliotheksinformationen, einbeziehen, schließlich würde dies die Aufgabe erheblich vereinfachen und die Netzlistenerkennung beschleunigen. Allerdings würde dann auch ein Fehler in der Bibliothek berücksichtigt werden – und die abschließende Netzlistenprüfung damit trotz des Fehlers identische Netzlisten ermitteln, da beide Listen von demselben bibliotheksbasierten Fehler betroffen wären. Dies würde das LVS unbrauchbar machen.

Zusätzliche parasitäre Kopplungseffekte enstehen durch das für alle Bauelemente gleiche Chipsubstrat. Diese Effekte werden jedoch nicht in allen Simulationswerkzeugen berücksichtigt.

M. R. Barbacci, A comparison of register transfer languages for describing computers and digital systems, in Technical Report (Carnegie Mellon University Research Showcase @ CMU, Department of Computer Science, 1973)

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A. Kahng, J. Lienig, I. Markov, et al., VLSI Physical Design: From Graph Partitioning to Timing Closure, 2. Aufl. (Springer, Cham, 2022). ISBN 978-3-030-39283-3. https://doi.org/10.1007/978-3-030-96415-3

K. Golshan, Physical Design Essentials (Springer, New York, 2007). ISBN 978-0-387-36642-5. https://doi.org/10.1007/978-0-387-46115-1

P. Spindler, Persönliches Gespräch (TU München, 2008)

S. M. Sait, H. Youssef, VLSI Physical Design Automation, Theory and Practice (World Scientific, Singapore, 1999)

R. J. Baker, CMOS circuit design, layout, and simulation, in IEEE Press Series on Microelectronic Systems, 3. Aufl. (Wiley-IEEE Press, Hoboken, 2010). ISBN 978-0470881323

M. Y. Hsueh, in Symbolic layout compaction, hrsg. v. P. Antognetti, D. O. Pederson, de H. Man. Computer Design Aids for VLSI Circuits, NATO ASI Series (Series E: Applied Sciences), Bd. 48 (Springer, 1984). ISBN 978-94-011-8008-5. https://doi.org/10.1007/978-94-011-8006-1_11

10.

B. Murphy, M. Pandey, S. Safarpour, Finding Your Way Through Formal Verification (CreateSpace Independent Publishing Platform, 2018). ISBN 978-1986274111

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D. Jansen et al., The Electronic Design Automation Handbook (Springer, New York, 2003). ISBN 978-14-020-7502-5. https://doi.org/10.1007/978-0-387-73543-6

12.

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Titel: Layoutentwurf in Schritten: Von der Netzliste bis zum Layout-Postprozess
verfasst von: Jens Lienig
Jürgen Scheible
Verlag: Springer International Publishing
Buch: Grundlagen des Layoutentwurfs elektronischer Schaltungen
Print ISBN: 978-3-031-15767-7

Electronic ISBN: 978-3-031-15768-4

Copyright-Jahr: 2023
DOI: https://doi.org/10.1007/978-3-031-15768-4_5