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Über dieses Buch

This book describes analytical models and estimation methods to enhance performance estimation of pipelined multiprocessor systems-on-chip (MPSoCs). A framework is introduced for both design-time and run-time optimizations. For design space exploration, several algorithms are presented to minimize the area footprint of a pipelined MPSoC under a latency or a throughput constraint. A novel adaptive pipelined MPSoC architecture is described, where idle processors are transitioned into low-power states at run-time to reduce energy consumption. Multi-mode pipelined MPSoCs are introduced, where multiple pipelined MPSoCs optimized separately are merged into a single pipelined MPSoC, enabling further reduction of the area footprint by sharing the processors and communication buffers. Readers will benefit from the authors’ combined use of analytical models, estimation methods and exploration algorithms and will be enabled to explore billions of design points in a few minutes.

Inhaltsverzeichnis

Frontmatter

2014 | OriginalPaper | Buchkapitel

Chapter 1. Introduction

Haris Javaid, Sri Parameswaran

2014 | OriginalPaper | Buchkapitel

Chapter 2. Literature Survey

Haris Javaid, Sri Parameswaran

2014 | OriginalPaper | Buchkapitel

Chapter 3. Optimisation Framework

Haris Javaid, Sri Parameswaran

2014 | OriginalPaper | Buchkapitel

Chapter 4. Performance Estimation of Pipelined MPSoCs

Haris Javaid, Sri Parameswaran

2014 | OriginalPaper | Buchkapitel

Chapter 5. Design Space Exploration of Pipelined MPSoCs

Haris Javaid, Sri Parameswaran

2014 | OriginalPaper | Buchkapitel

Chapter 6. Adaptive Pipelined MPSoCs

Haris Javaid, Sri Parameswaran

2014 | OriginalPaper | Buchkapitel

Chapter 7. Power Management in Adaptive Pipelined MPSoCs

Haris Javaid, Sri Parameswaran

2014 | OriginalPaper | Buchkapitel

Chapter 8. Multi-mode Pipelined MPSoCs

Haris Javaid, Sri Parameswaran

2014 | OriginalPaper | Buchkapitel

Chapter 9. Conclusions and Future Work

Haris Javaid, Sri Parameswaran

Backmatter

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