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2016 | OriginalPaper | Buchkapitel

An Efficient On-Chip Implementation of Reconfigurable Continuous Time Sigma Delta ADC for Digital Beamforming Applications

verfasst von : Anjani Harsha Vardhini Palagiri, Madhavi Latha Makkena, Krishna Reddy Chantigari

Erschienen in: Proceedings of the Second International Conference on Computer and Communication Technologies

Verlag: Springer India

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Abstract

SONAR and RADAR makes use of multiple beamforming systems. A novel Onboard Digital Beamforming (DBF) system suitable for various applications is implemented with mixed signal design of Sigma Delta ADC architecture. FPGA is configured as a Reconfigurable On-chip Sigma Delta ADC and analyzed for a multichannel beamforming system with Spartan 6, Virtex 4, and Virtex 6 FPGA. With the architectural variation, major advantages can be seen in SONAR beamforming and similar array processing applications.

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Literatur
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9.
Harsha Vardhini, P.A. et. al.: Optimum decimation and filtering for reconfigurable sigma delta ADC. Far East J. Electron. Commun. 11(2), 101–111
Metadaten
Titel
An Efficient On-Chip Implementation of Reconfigurable Continuous Time Sigma Delta ADC for Digital Beamforming Applications
verfasst von
Anjani Harsha Vardhini Palagiri
Madhavi Latha Makkena
Krishna Reddy Chantigari
Copyright-Jahr
2016
Verlag
Springer India
Buch
Proceedings of the Second International Conference on Computer and Communication Technologies

Print ISBN: 978-81-322-2525-6

Electronic ISBN: 978-81-322-2526-3

Copyright-Jahr: 2016

DOI
https://doi.org/10.1007/978-81-322-2526-3_31

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    Bildnachweise