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Erschienen in:
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2017 | OriginalPaper | Buchkapitel

Exploring HLS Optimizations for Efficient Stereo Matching Hardware Implementation

verfasst von : Karim M. A. Ali, Rabie Ben Atitallah, Nizar Fakhfakh, Jean-Luc Dekeyser

Erschienen in: Applied Reconfigurable Computing

Verlag: Springer International Publishing

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Abstract

Nowadays, FPGA technology offers a tremendous number of logic cells on a single chip. Digital design for such huge hardware resources under time-to-market constraint urged the evolution of High Level Synthesis (HLS) tools. In this work, we will explore several HLS optimization steps in order to improve the system performance. Different design choices are obtained from our exploration such that an efficient implementation is selected based on given system constraints (resource utilization, power consumption, execution time, ...). Our exploration methodology is illustrated through a case study considering a Multi-Window Sum of Absolute Difference stereo matching algorithm. We implemented our design using Xilinx Zynq ZC706 FPGA evaluation board for gray images of size \(640\times 480\).

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Metadaten
Titel
Exploring HLS Optimizations for Efficient Stereo Matching Hardware Implementation
verfasst von
Karim M. A. Ali
Rabie Ben Atitallah
Nizar Fakhfakh
Jean-Luc Dekeyser
Copyright-Jahr
2017
Buch
Applied Reconfigurable Computing

Print ISBN: 978-3-319-56257-5

Electronic ISBN: 978-3-319-56258-2

Copyright-Jahr: 2017

DOI
https://doi.org/10.1007/978-3-319-56258-2_15

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    Bildnachweise