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2016 | OriginalPaper | Buchkapitel

PLL-Free, High Data Rate Capable Frequency Synthesizers

verfasst von : Raghavasimhan Thiruarayanan, David Ruffieux, Christian Enz

Erschienen in: Efficient Sensor Interfaces, Advanced Amplifiers and Low Power RF Systems

Verlag: Springer International Publishing

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Abstract

The PLL based frequency synthesizer has been the main impediment to achieve a low energy dissipation in the radios employed in Wireless Sensor Networks (WSN); in spite of duty cycling. This is due to the crystal oscillator reference in the frequency synthesizer which dissipates significant energy during its long wakeup phase. To address this issue and thereby obtain the full advantage proffered by duty cycling, an overview of FBAR based synthesizers which can wake up in just 5 μs is presented. In addition, these synthesizers can also support high data rates as compared to the PLL based radios, thereby offering the possibility to increase the rate of duty cycling and thus further lowering the average energy dissipation.

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Metadaten
Titel
PLL-Free, High Data Rate Capable Frequency Synthesizers
verfasst von
Raghavasimhan Thiruarayanan
David Ruffieux
Christian Enz
Copyright-Jahr
2016
Buch
Efficient Sensor Interfaces, Advanced Amplifiers and Low Power RF Systems

Print ISBN: 978-3-319-21184-8

Electronic ISBN: 978-3-319-21185-5

Copyright-Jahr: 2016

DOI
https://doi.org/10.1007/978-3-319-21185-5_13

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    Bildnachweise