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2016 | OriginalPaper | Buchkapitel

2. Architecture of Target FPGA Platform

verfasst von : Ayan Palchaudhuri, Rajat Subhra Chakraborty

Erschienen in: High Performance Integer Arithmetic Circuit Design on FPGA

Verlag: Springer India

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Abstract

This chapter provides an insight into the architecture of Configurable Logic Blocks (CLBs), the basic building blocks of a FPGA, including details of the Look-Up Tables, wide function multiplexers, carry chains, flip-flops, and DSP slices. It also gives an overview of the different modes of implementation supported by Xilinx ISE to realize arithmetic functions.

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Literatur
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Metadaten
Titel
Architecture of Target FPGA Platform
verfasst von
Ayan Palchaudhuri
Rajat Subhra Chakraborty
Copyright-Jahr
2016
Verlag
Springer India
Buch
High Performance Integer Arithmetic Circuit Design on FPGA

Print ISBN: 978-81-322-2519-5

Electronic ISBN: 978-81-322-2520-1

Copyright-Jahr: 2016

DOI
https://doi.org/10.1007/978-81-322-2520-1_2

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