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2017 | OriginalPaper | Buchkapitel

Performance Optimized 64b/66b Line Encoding Technique for High Speed SERDES Devices

verfasst von : Jatindeep Singh, Satyajit Mohapatra, Nihar Ranjan Mohapatra

Erschienen in: VLSI Design and Test

Verlag: Springer Singapore

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Abstract

The 64b/66b technique conventionally is suited for low BER fiber optic channels, but can be extended for higher BER channels by including proper error correcting code and preamble. A modified 64b/66b line encoding technique for the design of high speed SERDES is proposed. Unlike earlier 8b/10b technology, run-length is no more guaranteed but is statistically bound. Generated polynomials are statistically tested in MATLAB prior VHDL implementation. Optimal selection of primitive polynomial limits run length to 11 and provides sub-optimal data security. Proposed 64/66b encoding technique reduces overhead by 15.8% (at 6.3% CRC) with respect to conventional 8b/10b, while is also suited for high BER channels like wireless and free space. A performance optimum between security, run-length, ISI and DC equalization, this scheme finds potential application in space camera electronics, 5G technology and other IOT applications like driverless cars that require to handle large volumes of real time data with sufficient security on high BER wireless channels.

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Literatur
2.
Zurück zum Zitat Datasheet of the COTS SERDES (Texas Instruments Part No. TLK2711, DS90UR241) Datasheet of the COTS SERDES (Texas Instruments Part No. TLK2711, DS90UR241)
3.
Zurück zum Zitat Richard, T., Donald, A., Steve, D., et al.: U.S. Patent No. 20,030,217,215, Washington (2003) Richard, T., Donald, A., Steve, D., et al.: U.S. Patent No. 20,030,217,215, Washington (2003)
4.
Zurück zum Zitat Walker, R., Dugan, R.: 64b/66b low overhead proposal for seriel links, IEEE 802.3 (2000) Walker, R., Dugan, R.: 64b/66b low overhead proposal for seriel links, IEEE 802.3 (2000)
5.
Zurück zum Zitat Gupta, H.S., et al.: 64b/66b Line Encoding for High Speed Serializers, IEEE VLSID (2017) Gupta, H.S., et al.: 64b/66b Line Encoding for High Speed Serializers, IEEE VLSID (2017)
7.
Zurück zum Zitat Weldon Jr., E.J.: U.S. Patent No. 4,723,246. Washington, DC US 06/759,491 (1988) Weldon Jr., E.J.: U.S. Patent No. 4,723,246. Washington, DC US 06/759,491 (1988)
8.
Zurück zum Zitat Radiation-Tolerant ProASIC3 Low Power Spaceflight Flash FPGA, Datasheet, Rev5 (2012) Radiation-Tolerant ProASIC3 Low Power Spaceflight Flash FPGA, Datasheet, Rev5 (2012)
Metadaten
Titel
Performance Optimized 64b/66b Line Encoding Technique for High Speed SERDES Devices
verfasst von
Jatindeep Singh
Satyajit Mohapatra
Nihar Ranjan Mohapatra
Copyright-Jahr
2017
Verlag
Springer Singapore
DOI
https://doi.org/10.1007/978-981-10-7470-7_6

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